Giáo trình Bảo dưỡng kỹ thuật điện tử (Phần 2)

mạch 3.15a đã xét. c - Tương tự như sơ đồ trigơ Smit dùng tranzito hình 3.12a, có thể dùng các mạch 3.15a và 3.15c để tạo các xung vuông góc từ dạng điện áp vào bất kì (tuần hoàn). Khi đó chu kì xung ra Tra = Tvào. Điều này đặc biệt có ý nghĩa khi cần sửa và tạo lại dạng một tín hiệu tuần hoàn với thông số cơ bản là tần số giống nhau (hay chu kì đồng bộ nhau). Hình 3.16a và b đưa ra ví dụ giản đồ minh họa biến đổi điện áp hình sin lối vào thành xung vuông lối ra sử dụng trigơ Smit đảo (3.16a) và trigơ Smit không đảo (3.16b). Các hệ thức từ (3-9) đến (3-14) cho phép xác định các mức ngưỡng lật của trigơ Smit và những thông số quyết định tới giá trị của chúng. Trigơ Smit là dang mạch cơ Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 208 bản để từ đó xây dựng các mạch tạo dao động xung dùng IC tuyến tính sẽ được xét trong các phần tiếp của chương này. 3.3. MẠCH KHÔNG ĐỒNG BỘ MỘT TRẠNG THÁI ỔN ĐỊNH Đây là loại mạch có một trạng thái ổn định bền. Trạng thái thứ hai của nó chỉ ổn định trong một khoảng thời gian nhất định nào đó (phụ thuộc vào tham số của mạch) sau đó mạch lại quay về trạng thái ổn định bền ban đầu. Vì thế, mạch còn có tên là trigơ một trạng thái ổn định hay đa hài đợi hay đơn giản hơn là mạch rơ le thời gian. 3.3.1. Đa hài đợi dùng tranzito Hình 3.17a chỉ ra mạch điện nguyên lí và hình 3.17b là giản đồ đlện áp - thời gian minh họa nguyên lí hoạt động của mạch đa hài đợi dùng tranzito. Hình 3.17: Mạch điện nguyên lý đa hài đợi dùng tranzito (a), giản đồ thời gian qua bốn điểm đo Uvào; UB1; UB2; Ura (b) Thực chất mạch hình 3.17a là một trigơ RS, trong đó một trong các điện trở hồi tiếp dương được thay bằng một tụ điện. Trạng thái ban đầu T2 mở -T1 khóa nhờ R, T2 mở bão hòa làm UCE2 = UBEI = 0 nên T1 khóa, đây là trạng thái ổn định bền (gọi là trạng thái đợi). Lúc t = to có xung điện áp dương ở lối vào mở T1, điện thế cực colectơ của T1 giảm từ +E xuống gần bằng 0. Bước nhảy điện thế này thông qua bộ lọc tần số cao RC đặt toàn bộ đến cực bazơ của T2 làm điện thế ở đó đột biến từ mức thông (khoảng +0,6v) đến mức -E + 0,6v ≈ -E, do đó T2 bị khóa lại. Khi đó T1 được đuy trì ở trạng thái mở nhờ mạch hồi tiếp dương R1R2 ngay cả khi điện áp vào bằng 0. Tụ C (đấu qua R đến điện thế +E) bắt đầu nạp điện làm điện thế cực bazơ T2 biến đổi theo quy luật : Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 209 UB2 ≈ E [ 1 - 2exp( -t/RC )] (3-15) Với điều kiện ban đầu: UB2(T = to) = -E và điều kiện cuối: UB2(T -> ∞) = E T2 bị khóa cho tới lúc t = t1 (h.3.17b) khi UB2 đạt tới giá trl +0,6 khoảng thời gian này xác định từ điều kiện UB2(t1) = 0 và quyết định độ dài xung ra tx: t1- to = tx = RCln2 = 0,7RC (3-16) Sau lúc t = t1, T2 mở và quá trình hồi tiếp dương qua R1, R2 đưa mạch về lại trạng thái ban đầu, đợi xung vào tiếp sau (lúc t = t2). Lưu ý những điều trình bày trên đúng khi T > tx > tx (3-17) (tx là độ rộng xung vào và Tv là chu kì xung vào) và khi điều kiện (3-17) được thỏa mãn thì ta luôn có chu kì xung ra Tra = Tv. 3.3.2. Mạch đa hài đợi dùng IC thuật toán Hình 3.18: Nguyên lý mạch đa hài đợi dùng IC. Khởi động bằng cực tính dương (a), cực tính âm (c), giản đồ điện áp tương ứng (b) và (d) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 210 Hình 3.18a đưa ra một dạng của sơ đồ nguyên lí mạch đa hài đợi dùng IC thuật toán và hình 3.18b là giản đồ thời gian giải thích hoạt động của mạch. Để đơn giản, giả thiết IC được cung cấp từ một nguồn đối xứng ±E và khi đó Uramax = |Uramin| = Umax Ban đầu lúc t < t1, Uv = 0; D thông nối đất (bỏ qua sụt áp thuận trên điôt) do Ura = -Umax từ đó UN= Uc = 0. Qua mạch hồi tiếp dương R1 R2, -Umax đưa tới đầu vào P điện áp Up = -bUmax. (với 21 1 RR Rβ + = là hệ số phân áp mạch hồi tiếp). Đây là trạng thái ổn định bền (trạng thái đợi) của mạch. Lúc t = t1 có xung nhọn cực tính dương tới đầu vào P. Nếu biên độ thích hợp vượt hơn giá trị -bUmax, sơ đồ lật sang trạng thái cân bằng không bền với Ura = +Uramax= Umax và qua mạch hồi tiếp dương có Up = bUmax. Sau lúc t1, điện áp ra Umax nạp cho tụ C làm cho Uc = UN dương dần cho tới lúc t=t2 khi đó UN = bUmax thì xảy ra đột biến do điện thế đầu vào vi mạch UN- Up đổi dấu, điện áp ra đổi dấu lần thứ hai Ura= -Umax (lưu ý trong khoảng t1 - t2, UN = Uc > 0 nên điôt bị phân cực ngược và tách khỏi mạch). Tiếp đó, sau lúc t2 tụ C phóng điện qua R hướng tới giá trị điện áp ra lúc đó là - Umax lúc t = t3, Uc = Un » 0 điốt trở nên mở, ghim mức thế đầu vào đảo ở giá trị 0, mạch quay về trạng thái đợi ban đầu. Nếu xung khởi động Uvào cực tính âm, có thể dùng sơ đồ hình 3.18c với tần số xung ra thay đối được nhờ R. Hoạt động của mạch được minh họa trên đồ thị hình 3-18d. Với 3.18a, b ta có nhận xét độ rộng xung tx = t2-t1 có liên quan tới quá trình nạp cho tụ C từ mức 0 tới mức -bUmax . Từ đó, với giả thiết U+ramax=|U-ramin| = Umax ta có )e(1U(t)U(t)U t/RCmaxNc -== (3-18) thay giá trị Uc(t1) = 0, Uc(t2) = bUmax vào phương trình (3-18) ta có ÷÷ ø ö çç è æ +=÷÷ ø ö çç è æ - =-= 2 1 12x R R1RCln β1 1RClnttt (3-19) Gọi t3 - t2 = thph là thời gian hồi phục về trạng thái ban đầu của sơ đồ, có liên quan tới quá trình phóng điện của tụ C từ mức bUmax về mức 0 hướng tới lúc xác lập Uc(∞) = -Umax xuất phát từ phương trình: Uc(t) = Uc(∞) - [Uc(∞) - Uc(0)] exp ( -t / RC) (3-20) có kết quả: thph = RCln (1 + b) = RCln[1+R1 / ( R1 + R2) (3-21) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 211 So sánh hai biểu thức xác định tx và thph thấy do b > thph . Người ta cố gắng chọn các thông số và cài tiến mạch để thph giảm nhỏ, nâng cao độ tin cậy của mạch khi có dãy xung tác động đầu vào. Khi đó cần tuân theo điều kiện: tx + thph < Tvào = Tra (3-22) với Tv là chu kỳ dãy xung khởi động ở cửa vào. Các hệ thức (3-19) và (3-21) cho xác định các thông số quan trọng nhất của mạch 3.18a. 3.4. MẠCH KHÔNG ĐỒNG BỘ HAI TRẠNG THÁI KHÔNG ỔN ĐỊNH (ĐA HÀI TỰ DAO ĐỘNG) 3.4.1. Đa hài dùng tranzito Nếu thay thế điện trở hồi tiếp còn lại trong mạch hình 3.17 bằng 1 tụ điện thứ 2 ta nhận được mạch hình 3.19 là mạch đa hài tự dao động dùng tranzito. Lúc đó trạng thái cân bằng của mạch (một tranzito khóa, một tranzito mở) chỉ ổn định trong một thời gian hạn chế nào đó, rồi tự động lật sang trạng thái kia và ngược lại. Hình 3.19b cho biểu đồ thời gian của mạch đa hài tự dao động 3.19a. · Hai trạng thái nêu trên của mạch đa hài tự dao động còn được gọi là các trạng thái chuẩn cân bằng. Ở đó những thay đổi tương đối chậm của dòng điện và điện áp giữa các điểm trong sơ đồ dần dẫn tới một trạng thái tới hạn nào đó, mà tại đấy có những điều kiện để tự động chuyển đột ngột từ trạng thái này sang trạng thái khác. Nếu tác động tới các cửa vào một điện áp đồng bộ nào đó có chu kì lặp xấp xỉ nhưng ngắn hơn chu kì bản thân của điện áp dao động, quá trình chuyển đột ngột sẽ xảy ra sớm hơn, tương ứng lúc đó ta có chế độ làm việc đồng bộ của đa hài tự dao động mà đặc điểm chính là chu kì của xung ra phụ thuộc vào chu kì của điện áp đồng bộ, còn độ rộng xung ra do các thông số RC của mạch quy đinh. · Nguyên lí hoạt động của mạch hình 3.19a có thể tóm tắt như sau: Việc hình thành xung vuông ở cửa ra được thực hiện sau một khoảng thời gian t1=t1 - to (đối với cửa ra 1hoặc t2=t2 – t1 (với cửa ra 2) nhờ các quá trình đột biến chuyển trạng thái của sơ đồ tại các thời điểm t0, t1, t2... Trong khoảng t1 tranzito T1 khóa T2.mở. Tụ C1 đã được nạp đầy điện tích trước lúc to phóng điện qua T2 qua nguồn Ec qua R1 theo đường +C1 -> T2 -> R1 -> -C1 làm điện thế trên gực bazơ của T1 thay đổi theo hình 3.19.b. Đồng thời trong khoảng thời gian này tụ C2 được nguồn E nạp theo đường +E -> Rc -> T2 -> -E làm điện thế trên cực bazơ T2 thay đổi theo dạng 8.19b. Lúc t = t1 thì UB1» 0,6V làm T2 mở và xảy ra quá trình đột biến lần thứ nhất, nhờ mạch hói tiếp dương làm sơ đồ lật đến trạng thái T1 mở T2 khóa. Trong khoảng thời gian t2=t2 – t1 trạng thái trên được giữ nguyên, tụ C2 (đã được nạp trước lúc t1) bắt đầu phóng điện và C1 bắt đầu quá trình nạp tương tự như đã nêu trên cho tới lúc t = t2, UB2 = +0,6V làm T2 mở và xảy ra đột biến lần thứ hai chuyển sơ đồ về trạng thái ban đầu: T1 khóa T2 mở... Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 212 Hình 3.19: Mạch nguyên lý bộ đa hài tự dao động(a) và biểu đồ thời gian (b) · Các tham số chủ yếu và xung vuông đầu ra được xác định dựa trên việc phân tích nguyên lí vừa nêu trên và ta thấy rõ độ rộng xung ra t1 và t2 liên quan trực tiếp với hằng số thời gian phóng của các tụ điện từ hệ thức (3-16), tương tự có kết quả: t1 = RCln2 » 0,7R1C1 (3-23) t2 = R2C2ln2 = 0,7R2C2 Nếu chọn đổi xứng RI = R2; C1 = C2, T1 giông hệt T2 ta có t1 =t2 và nhận được sơ đồ đa hài đối xứng, ngược lại ta có đa hài không đối xứng. Chu kỳ xung vuông Tra =t1 +t2 Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 213 Biên độ xung ra được xác định gần đúng bằng giá trị nguồn E cung cấp. Để rạo ra các xung có tầnn số thấp hơn 1000Hz, các tụ trong sơ đồ cần có điện dung lớn. Còn để tạo ra các xung có tần số cao hơn 10kHz ảnh hưởng có hại của quán tính các tranzito (tính chất tần số) làm xấu các thông số của xung vuông nghiêm trọng. Do vậy, dải ứng dụng của sơ đồ hình 3.19a là hạn chế và ở vùng tần số thấp và cao người ta đưa ra các sơ đồ đa hài khác tạo xung có ưu thế hơn mà ta sẽ xét dưới đây. 3.4.2. Mạch đa hài dàng IC tuyến tính Để lập các xung vuông tần số thấp hơn 1000HZ sơ đồ đa hài (đối xứng hoặc không đối xứng) dùng IC tuyến tính dựa trên cấu trúc của một mạch so sánh hồi tiếp dương có nhiều ưu điểm hơn sơ đố dùng tranzito đã nêu. Tuy nhiên do tính chất tần số của IC khá tốt nên với những tần số cao hơn việc ứng dụng sơ đồ IC vẫn mang nhiều ưu điểm (xét với tham số xung). Hình 3.20a và b đưa ra mạch điện nguyên lý của đa hài đối xứng đùng IC thuật toán cùng giản đồ thời gian giải thích hoạt động của sơ đồ. Dựa vào các kết quả đã nêu ở 3.2.3, với trigơ Smit, có thể giải thích tóm tắt hoạt động của mạch 3:20(a) như sau: Khi điện thế trên đầu vào N đạt tới ngưỡng lật của trigơ Smit thì sơ đồ chuyển trạng thái và điện áp ra đột biến giá trị ngược lại với giá trị cũ. Sau đó điện thế trên đầu vào N thay đổi theo hướng ngược lại và tiếp tục cho tới khi chưa đạt được ngưỡng lật khác (ví dụ khoảng (t1 ¸ t2) trên hình vẽ 3.20b). Sơ đồ lật về trạng thái ban đầu vào lúc t2 khi UN = Uđóng = -bUmax . Quá trình thay đổi UN được điều khiển bởi thời gian phóng và nạp của C bởi Ura qua R. Nếu chọn Uramax = Uramin = Umax thì Uđóng = -bUmax Ungắt = -bUmax ; b = R1/(R1+R2) Hình 3.20: Bộ đa hài trên cơ sở bộ khuếch đại thuật toán Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 214 là hệ số hồi tiếp dương của mạch. Cần lưu ý điện áp vào cửa N, chính là điện áp trên tụ C, sẽ biến thiên theo thời gian theo quy luật quá trình phóng điện và nạp điện của C từ nguồn Umax hay - Umax thông qua R trong các khoảng thời gian 0 ¸ t1 và t1¸t2... lúc đó phương trình vi phân để xác định UN(t) có dạng: RC UU dt dU NmaxN -±= (3-24) với điều kiện ban đầu UN (t = 0) = Uđóng = -bUmax có nghiệm UN(t) = Umax {1 – [ 1 + bexp ( - t / RC)]} (3-25) UN sẽ đạt tới ngưỡng lật của trigơ Smit sau một khoảng thời gian bằng: t = RCln (1+ b)/(1-b) = RCln ( 1 + 2R1/R2) (3-26) Từ đó chu kỳ dao động được xác đinh bởi: Tra = 2t = 2RCln ( 1 + 2R1/R2) (3-27) Nếu chọn R1 = R2 ta có : Tra » 2,2 RC (3-28a) tức chu kì dao động tạo ra chỉ phụ thuộc các thông số mạch ngoài R1 và R2 (mạch hồi tiếp dương) và R, C (mạch hồi tiếp âm). Các hệ thức (3-26) và (3-27) cho xá định các tham số cơ bản nhất của mạch. Khi cần thiết kế các mạch đa hài có độ ổn định tần số cao hơn và có khả năng điều chỉnh tần số ra, người ta sử dụng các mạch phức tạp hơn. 3.5. BỘ DAO ĐỘNG BLOCKING Blocking (bộ dao động nghẹt) là một bộ khuếch đại đơn hay đẩy kéo có hồi tiếp dương mạnh qua một biến áp xung (h.3.22a), nhờ đó tạo ra các xung có độ rộng hẹp (cỡ 10-3 ¸ 10-6s) và biên độ lớn. Blocking thường được đùng để tạo ra các xung điều khiển trong các hệ thống số. Blocking có thể làm việc ở chế độ khác nhau: chế độ tự đao động, chế độ đợi, chế độ đồng bộ hay chế độ chia tần. Hình 3.22a là mạch nguyên lí Blocking tự dao động gồm 1 trazito T mắc emitơ chung với biến áp xung Tr có 3 cuộn wk sơ cấp, wB và wt (thứ cấp). Quá trình hồi tiếp dương thực hiện từ wk qua wB nhờ cực tính ngược nhau của chúng. Tụ C và điện trở R để hạn chế dòng điện cực bazơ. Điện trở R tạo dòng phóng điện cho tụ C (lúc T khóa). Điôt D1 để loại xung cực tính âm trên tải sinh ra khi tranzito chuyển chế độ từ mở sang khóa. Mạch R1, D2 để bảo vệ tranzito khỏi bị quá áp. Các hệ số biến áp xung là nb và nt được xác định bởi: nb = wk / wB ; nt = wk / wt (3-29) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 215 Hình 3.22a: Mạch nguyên lý Blocking đơn (a) và tín hiệu ra (b) Quá trình dao động xung liên quan tới thời gian mở và được duy trì ở trạng thái bão hòa (nhờ mạch hồi tiếp dương) của tranzito. Kết thúc việc tạo dạng xung là lúc tranzito ra khỏi trạng thái bão hòa và chuyển đột biến về tắt (khóa) nhờ hồi tiếp dương. + Trong khoảng 0 0; tụ C phóng điện qua mạch (wB-> C -> R -> RB -> - Ecc lúc t1, Uc = 0 + Trong khoảng t1 < t < t2 khi Uc chuyển qua giá trị 0 xuất hiện quá trình đột biến Blocking thuận nhờ hồi tiếp dương qua wB dẫn tới mở hẳn tranzito tới bão hòa. + Trong khoảng t2 < t < t3 T bão hòa sâu, điện áp trên cuộn wk gần bằng trị số Ecc đó là giai đoạn tạo đỉnh xung, có sự tích lũy năng lượng từ trong các cuộn dây của biến áp, tương ứng điện áp hồi tiếp qua wB là UwB= Ecc / nB (3-30) và điện áp trên cuộn tải wt là UwB= Ecc / nt Lúc này tốc độ thay đổi dòng colectơ giảm nhỏ nên sức điện động cảm ứng trên wk , wB giảm làm dòng cực bazơ Ib giảm theo, do đó làm giảm mức bão hòa của T đồng thời tụ C được Ib nạp qua mạch đất - tiếp giáp emitơ - bazơ của T - RC - wB - đất. Lúc đó do Ib giảm tới trị số tới hạn Ib = IBgh = Ic = Icbh/b xuất hiện quá trình hối tiếp dương theo hướng ngược lại (quá trình Blocking ngược): T thoát khỏi trạng thái bão hòa Ic giảm và Ib giảm ... đưa T đột ngột về trạng thái khóa dòng Ic = 0. Tuy nhiên, do quán tính của cuộn dây trên cực colectơ xuất hiện sđđ tự cảm chống lại sự giảm đột ngột của dòng điện, do đó hình thành một mức điện áp âm biên độ lớn (quá giá trị Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 216 nguồn Ecc) đây là quá trình tiêu tán năng lượng từ trường đã tích lũy trước, nhờ dòng thuận từ chảy qua mạch D2R1, lúc này cuộn wt cảm ứng điện áp âm lam D1 tắt và tách mạch tải khỏi sơ đồ. Sau đó tụ C phóng điện duy trì T khóa cho tới khi Uc = 0 sẽ lặp lại một nhịp làm việc mới. · Độ rộng xung Blocking tính được là tx = t3 – t1 =(R + rv) Cln B.R1/ nB(Rt + rv) (3-31) trong đó rv là điện trở vào của tranzito lúc mở Rt = nt2Rt là tải phản ảnh về mạch cực colectơ (mạch sơ cấp) b là hệ số khuếch đại dòng tĩnh của T. Thời gian hồi phục t4 ¸ t6 (h.3.22) do thời gian phóng điện của tụ quyết định và được xác định bởi: thph = t6 - t4 = C. RBln(1+1/nB) (3-32) Nếu bỏ qua các thời gian tạo sườn trước và sườn sau của xung thì chu kì xung Tx ≈ tx + thph (3-33a) và tần số của dãy xung là: hphx tt 1f + = · Sơ đồ Blocking có thể xây dựng từ hai tranzito mắc đẩy kéo làm việc với một biến áp xung bão hòa từ để tạo các xung vuông với hiệu suất năng lượng cao và chất lượng tham số xung tốt. Điểm lưu ý sau cùng là khi làm việc ở chế độ đồng bộ cần chọn chu kì của dãy xung đồng bộ Tv nhỏ hơn chu kì của Tx của dãy xung do Blocking tạo ra. Nếu ở chế độ chia tần thì cần tuân theo điều kiện Tx >>tv và khi đó có đãy xung đầu ra có chu kỳ lặp là Tra = nTvào (h.3.23a và b) với n là hệ số chia. 3.6. MẠCH TẠO XUNG TAM GIÁC (XUNG RĂNG CƯA) 3.6.1. Các vấn đề chung Xung tam giác được sử dụng phố biến trong các hệ thống điện tử: Thông tin, đo lường hay tự động điều khiển làm tín hiệu chuẩn hai chiều biên độ (mức) và thời gian có vai trò quan trọng không thể thiếu được hầu như trong mọi hệ thống điện tử hiện đại. Hình 3.24 đưa ra dạng xung tam giác lý tưởng với các tham số chủ yếu sau: Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 217 Hình 3.24: Xung tam giác lý tưởng Biên độ Umax mức một chiều ban đầu Uq (t = 0) = U0 chu kì lặp lại T (so với xung tuần hoàn), thời gian quét thuận tq và thời gian quét ngược tng (thông thường tng << tq), tốc độ quét thuận hay độ nghiêng vi phân của đường quét. dt (t)dU K q= Để đánh giá chất lượng Uq thực tế so với lý tưởng có hệ số không đường thẳng E được định nghĩa là : % (0)U' )(tU'(0)U' 0)/dt(tdU )t/dt(tdU0)/dt(tdU ε q qqq q qqq -= = =-» = (3-33b) Ngoài ra còn các tham số khác như: tốc độ quét trung bình KTB = Umax / tq và hiệu suất năng lượng: h = Umax / Enguồn Từ đó có hệ số phẩm chất của Uq là Q = h / e. Nguyên lí tạo xung tam giác dựa trên việc sử dụng quá trình nạp hay phóng điện của một tụ điện qua một mạch nào đó. Khi đó quan hệ dòng và áp trên tụ biến đổi theo thời gian có dạng dt (t)dUC(t)i cc = (3-34) trong điều kiện C là một hằng số, muốn quan hệ Uc(t) tuyến tính cần thỏa mãn điều kiện ic(t) = hằng số. Nói cách khác sự phụ thuộc của điện áp trên tụ điện theo thời gian càng tuyến tính khi dòng điện phóng hay nạp cho tụ càng ổn định. Có hai dạng xung tam giác cơ bản là: trong thời gian quét thuận tq, Uq tăng đường thẳng nhờ quá trình nạp cho tụ từ nguồn một chiều nào đó và trong thời gian quét thuận tq, Uq giảm đường thẳng nhờ quá trình phóng của tụ điện qua một mạch tải. Với mỗi dạng kể trên có các yêu cầu khác nhau, để đảm bảo tng <<tq, với dạng Uo U Umax t tq tng T Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 218 tăng đường thẳng cần nạp chậm phóng nhanh và ngược lại với dạng giảm đường thẳng cần nạp nhanh phóng chậm. . . , Để điều khiển tức thời các mạnh phóng nạp, thường sử dụng các khóa điện tử tranzito hay IC đóng mở theo nhịp điều khiển từ ngoài. Trên thực tế để ổn định dòng điện nạp hay dòng điện phóng của tụ cần một khối tạo nguồn dòng điện (xem 2.6) để nâng cao chất lượng xung tam giác. Về nguyên lí có 3 phương pháp cơ bản sau: a - Dùng một mạch tích phân đơn giản (h.3.25a) gồm một khâu RC đơn giản để nạp điện cho tụ từ nguồn E. Quá trình phóng, nạp được một khóa điện tử K điều khiển. Khi đó, Umax << E do đó phẩm chất của mạch thấp vì hệ số phi tuyến tỷ lệ với tỷ số Umax/E; E Uε max= (3-35) Nếu sử dụng phần tăng đường thẳng ta có Uc(t) = E [1- exp( - 1/RnC)] với RnC >>Rphóng.C. Nếu chọn nguồn E cực tính âm ta có Uc(t) là giảm đường thẳng. Hình 3.25: Phương pháp Mille tạo Uq b - Dùng một phần tử ổn định dòng kiểu thông số có điện trở phụ thuộc vào điện áp đặt trên nó Rn=f(URn) làm điện trở nạp cho tụ C. ĐỂ giữ cho dòng nạp không đổi, điện trở Rn giảm khi điện áp trên nó giảm, lúc đó e = Umax/Etd với Etd = Inạp . Ri (8-36) Ri là điện trở trong của nguồn dòng nên khá lớn, do vậy Etd lớn và cho phép nâng cao Umax với một mức méo phi tuyến cho trước. c - Thay thế nguồn E cố định ở đầu vào bằng một nguồn biển đổi e(t) = E + K (Uc - Uo) hay e(t) = E + KΔUC (3-37) với K là hằng số tỉ lệ bé hơn một: k = de(t)/dUc < l (với hình 3.26a) Nguồn bố sung KΔUC bù lại mức giảm của dòng nạp nhờ một mạch khuếch đại có hồi tiếp thay đổi theo điện áp trên tụ Uc khi đó mức méo phi tuyến xác định bởi: Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 219 e = (1-k)Umax/E (3-38) giá trị này thực tế nhỏ vì k ≈ 1 nên 1-k là VCB và vì thế có thể lựa chọn được Umax lớn xấp xỉ E làm tăng hiệu suất của mạch mà e vẫn nhỏ. 3.6.2. Mạch tạo xung tam giác dùng tranzito Hình 3.27 đưa ra các sơ đồ dùng tranzito thông dụng để tạo xung tam giác trong đó (a) là dạng đơn giản, (b) là mạch dùng phần tử ổn dòng (phương pháp Miller) và (c) là mạch bù có khuếch đại bám kiểu Bootstrap. Hình 3.27: Các mạch tạo xung tam giác dùng tranzito thông dụng nhất a. Với mạch (a): Ban đầu khi Uv = 0 (chưa có xung điều khiển) T mở bão hòa nhờ RB, điện áp ra Ura =Uc = UCEbh ≈ 0V. Trong thời gian có xung vuông, cực tính âm điều khiển đưa tới cực bazơ, T khóa, tụ C được nạp từ nguồn +E qua R làm điện áp trên tụ tăng dần theo quy luật Uc(t) = E (l - e-t/RC) (3-39) Điện áp này Uc(t) = Ura(t) ở gần đúng bậc nhất tăng đường thẳng theo t với hệ số phi tuyến Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 220 E U i )i(ti ε m 0 q0 = - = với i(0) = E/R (3-40) và R UE =)i(t mq là các dòng nạp lúc đầu và cuối Khi hết xung điểu khiển T mở lại, C phóng điện nhanh qua T; Ura=Uc≈0 mạch về lại trạng thái ban đầu. Từ biểu thức sai số e (3-40) thấy rõ muốn sai số bé cần chọn nguồn E lớn và biên độ ra của xung tam giác Um nhỏ. Đây là nhược điểm căn bản của sơ đồ đơn giản hình 3.27a. b. Với mạch (b) tranzito T2 mắc kiểu bazơ chung có tác dụng như một nguồn ổn dòng (có bù nhiệt nhờ dòng ngược qua ZD là điôt ổn áp (xem 2.6) cung cấp dòng IE2 ổn định nạp cho tụ trong thời gian có xung vuông cực tính âm điều khiển làm khóa T1. Với điều kiện gần đúng dòng cực colectơ T1 không đổi thì: t C I =dtI C 1 =(t)U c2 t 0 c2c q ∫ là quan hệ bậc nhất (3-41) Mạch (b) cho phép tận dụng toàn bộ E tạo xung tam giác với biên độ nhận được là Um » E. Tuy vậy, khi có tải Rt nối song song trực tiếp với C thì có phân dòng qua Rt và Um giảm và do đó sai số e tăng. Để sử dụng tốt cần có biện pháp nâng cao Rt hay giảm ảnh hưởng của Rt đối với mạch ra của sơ đồ. c. Với mạch (c) T1 là phần tử khóa thường mở nhờ RB và chỉ khóa khi có xung vuông cực tính dương điều khiển. T2 là phần tử khuếch đại đệm chế độ đóng mở (k < 1). Ban đầu (Uv = 0) T1 mở nhờ Rb, điôt D thông qua R có dòng Io ≈ E/(R + Rd) với Uc = UCE1bh≈ 0. Qua T2 ta nhận được Ura≈ 0. Tụ Co được nạp tới điện áp UN - UE2 ≈ E với cực tính như hình 3.27. Trong thời gian có xung vào T1 bị khóa, C được nạp qua D và R làm điện thế tại M (cũng là điện thế cực bazơ T2) âm dần T2 mở mạnh, gia số ΔUc qua T2 và qua Co (có điện dung lớn) gần như được đưa toàn bộ về điểm N bù thêm với giá trị sẵn có tại N (đang giảm theo quy luật dòng nạp) giữ ổn định dòng trên R nạp cho C. Chú ý khi dòng hồi tiếp qua Co về N có trị số bằng E/R thì không còn dòng qua D dẫn tới cân bằng động, nguồn E dường như cắt khỏi mạch và C được nạp nhờ điện thế E đã được nạp trước trên Co. Sơ đồ (c) có ưu điểm là biên độ Um đạt xấp xỉ giá trị nguồn E trong khi sai số giảm đi (1 - k) lần (với k là hệ số truyền đạt của T2 mắc chung emitơ) và ảnh hưởng của Rt mắc tại cực emitơ của T2 thông qua tầng đệm phân cách T2 tới Uc(t) rất yếu. Các sơ đồ 3.27 a b c có thể sử dụng với xung điều khiển cực tính ngược lại khi chuyển mạch T1 được thiết kế ở dạng thường khóa (không có RB) 3.6.3. Mạch tạo xung tam giác dùng vi mạch thuật toán Hình 3.28 a và b đưa ra hai sơ đồ tạo xung tam giác dùng IC thuật toán. Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 221 Hình 3.28: Các mạch tạo xung tam giác dùng IC tuyền ttnh a) Dạng mạch tích phân đơn giản b) Dùng mạch phức tạp có điều chỉnh hướng quét và cực tính a - Mạch 3.28 a xây dựng trên cơ sở khuếch đại có đảo trong đó thay điện trở Rht bằng tụ C, khi đó điện áp ra được mô tả bởi (giả thiết Uo = 0) ( ) ( ) ( ) Q+dttI C 1 = C tQ =tU t 0 0cra ∫ (3-42) với Qo là điện tích có trên tụ tại lúc t = 0 với ( ) ( ) R tU =tI vàoc ta có ( ) ( ) U+dttURC 1 =tU t 0 ravàora ∫ (3-43) Thành phần Urao xác định từ điền kiện ban đầu của tích phân Urao = Ura (t = 0) = Q0 / C Nếu Uvào(t) là một xung vuông có giá trị không đại trong khoảng 0 ¸ t thì Ura(t) là một điện áp đường thẳng Ura(t) = ( - Uvào/RC). t + Urao (3-44) Độ chính xác của (3.44) là tùy thuộc vào giả thiết gần đúng Uo » 0 hay dòng điện đầu vào IC gần bằng 0, các vi mạch chất lượng cao đảm bảo điều kiện này khá tốt. Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 222 b - Hoạt động của mạch 3.28b được minh họa bằng giản đồ thời gian hình 3.29 . Khi có xung điều khiển cực tính dương, T mở bão hòa, thông mạch phóng điện cho tụ C trong khoảng thời gian to (to < tnghỉ với tnghỉ = tvào là thời gian có xung điều khiển). Trong khoảng tq (không có xung điều khiển) IC làm việc ở chế độ khuếch đại tuyến tính, nếu Uo = 0 thì Up = UN = Uc (3-45) Ta xác định quy luật biến đổi của Uc(t), từ đó tìm điều kiện để có quan hệ là tuyến tính như sau: Phương trình dòng điện tại nút N với mạch hồi tiếp âm: 2 raN 1 N0 R UU = R UE suy ra 1 2 0 1 21 cra R RE R RRUU -+= (3-46) Phương trình dòng tại núi P với mạch hồi tiếp dương: 4 racc 3 c R UU + dt dU C= R UE (3-47) Từ hai hệ thức (346) và (3-47) rút ra phương trình của Uc(t) RR RE R E C 1 = RR R R 1 C U = dt dU 41 20 341 2 3 cc (3-48) Tính chất biến đổi của Uc(t) phụ thuộc vào hệ số của số hạng thứ hai vế trái của (3- 48). Nếu R3 > R1R4/R2 đườg (t) có đạt đường cong lồi. Nếu R3<R1R4/R2 R2 đường Uc(t) có dạng đường cong lõm. Khi R1/R2=R3/R4 (3-49) thì Uc phụ thuộc bậc nhất vào t. Khi đó có: t RR R E R E C 1 =U 41 2 0 3 c (3-50) Nếu chọn R1 = R3 và R2 = R4 ta có biểu thức thu gọn ( )tEE CR 1 =U 0 3 c (3-51) Từ đó: Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 223 Nếu E > Eo có Ura là điện áp tăng đường thằng. Nếu E < Eo có Ura giảm đường thẳng. Nếu chọn Eo = 0 ta nhận được xung tam giác cực tính dương, còn chọn Eo là 1 nguồn điều chỉnh được thì Ura có dạng có hai cực tính với biên độ gần bằng 2Ec Trên thục tế, thường chọn E = Ec và Eo lấy từ Ec qua chia áp. Biên độ cực đại trên tụ C xác định bởi: Ucmax = (E - Eo)tq/ R3C (3-52) Người ta có thể tạo ra đồng thời một xung vuông và một xung tam giác nhờ ghép nối tiếp một bộ tích phân sau một trigơ Smit (h. 3.30). Bộ tích phân IC2 lấy tích phân điện áp ra ổn định trên lối ra (Ura1) của trigơ Smit. Khi Ura2 đạt ngưỡng tắt của trigơ thì điện áp ra của nó đổi dấu đột biến do đó Ura2 đổi hướng quét ngược lại. Quá trình lại tiếp diễn cho tới khi đạt tới ngưỡng lật thứ hai của trigơ Smit và sơ đồ quay về trạng thái đầu. Tần số của dao động thay đổi nhờ R hoặc C. Biên độ Ura2 chỉ phụ thuộc ngưỡng lật của trigơ Smit, được xác định bởi: Ura2 = Umax R1/R2 (3-53) (với Umax là giá trị điện áp ra bão hòa của IC1). Chu kì dao động xác định bởi T= 4RCR1/R2 (3-54) Hình 3.30: Sơ đồ tạo đồng thời xung vuông (Ura1) và xung tam giác (Ura2) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 224 3.7. CƠ SỞ ĐẠI SỐ LOGIC VÀ CÁC PHẦN TỬ LOGIC CƠ BẢN 3.7.1. Cơ số của đại số logic a - Hệ tiên đề và định lí Đại số logic là phương tiện toán học để phân tích và tổng hợp các hệ thống thiết bị và mạch số. Nó nghiên cứu các mối liên hệ, (các phép tính cơ bản) giữa các biến số trạng thái (biến logic) chỉ nhận một trong hai giá trị "1" (có) hoặc ''0" (không có). Kết quả nghiên cứu này thể hiện là một hàm trạng thái cũng nhận chỉ các trị số "0" hoặc "1”. Người ta xây đựng 3 phép tính cơ bản giữa các biến logic đó là: Phép phủ định logic (đảo), là kí hiệu bằng dấu "-" phía trên kí hiệu của biến Phép cộng logic (tuyển), kí hiệu bằng dấu "+" Phép' nhân logic (hội), kí hiệu bằng dấu "." Kết hợp với hai hằng số "O" và "1" có nhóm các quy tắc sau: Nhóm 4 quy tắc của phép cộng logic: x + 0 = x, x + x = x x + 1 = 1, x + x = 1 (3-55) Nhóm 4 quy tắc của phép nhân logic x . 0 = 0, x . x = x x . 1 = x, x . x = 0 (3-56) Nhóm hai quy tắc của phép phủ định logic. ( x) = x ( )x = x (3-57) Có thể minh họa tính hiển nhiên của các quy tắc trên qua ví dụ các khóa mạch điện nối song song (với phép cộng) và nối tiếp (với phép nhân) và hằng số 1ứng với khóa thường đóng nối mạch, "0" khóa thường mở ngắt mạch. - Tồn tại các đinh luật hoán vị, kết hợp và phân bố trong đại số logic với các phép cộng và nhân. Luật hoán vị: x + y = y + x; xy = yx (3-58) Luật kết hợp: x + y + z = (x + y) + z = x + (y + z) xyz = (xy)z = x(yz) (3-59) Luật phân bố: x(y + z) = xy + xz (3-60) - xuất phát từ các quy tắc và luật trên có thể đưa ra một số đinh lí thông dụng sau: x . y + x y = x; x( x + y) = xy x + xy = x; (x + y)(x + z) = x + yz Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 225 x(x + y) = x; x y + y = x + y (3-61) Định lí Đemorgan: ( ) ),...,.,z,y,xF(,.z,...y,x,F +=+ Ví dụ: ( ) z.y.x=z+y+x và ( ) zyxzx.y ++=. (3-62) b - Hàm logic và cách biểu diễn chúng Có 3 cách biểu diễn hàm logic tương đương nhau - Biểu diễn giải tích với các kí hiệu hàm, biến và các phép tính giữa chúng. Có hai dạng giải tích được sử dụng là dạng tuyển: hàm được cho dưới dạng một tổng của các tích các biến và dạng hội - dưới dạng muột tích của các tổng các biến. Nếu mỗi số hạng trong dạng tuyển chứa đủ mặt các biến ta gọi đó là một mintec kí hiệu là m và có dạng tuyển đầy đủ, tương tự với dạng hội đầy đủ là tích các maxtec (M). Mỗi hàm logic có thể có vô số cách biểu diễn giải tích tương đương ngoài hai dạng trên. Tuy nhiên, chỉ tồn tại một cách biểu diễn gọn nhất, tối ưu về số biến và số số hạng hay thừa số và được gọi là dạng tối thiểu. Việc tối thiểu hóa hàm logic, là đưa chúng từ một dạng bất kì về dạng đã tối thiểu, mang một ý nghĩa kinh tế kĩ thuật đặc biệt khi tổng hợp các mạch logic phức tạp. ' Ví dụ: Dạng tuyển đầy đủ F = x.y. z + xyz + x y z : m1 + m2 + m3 Dạng hội đầy đủ F = (x + y + z)( x+ y + z )(x + y + z) = M1. M2 . M3 - Biểu diễn hàm logic bằng bảng trạng thái trong đó liệt kê toàn bộ số tổ hợp biến có thể có được và giá trị hàm tương ứng với mỗi tổ hợp đã kể. Ví dụ: Với F(x, y, z) = x y z + xy z + x.y.z = m1 + m6 + m7 (3-63) 3.7.2. Các phần tứ togic cơ bản Các phép toán cơ bản của đại số logic có thể được thực hiện bằng các mạch khóa điện tử (tranzito hoặc IC) đã nêu ở phần 3.1. Nét đặc trưng nhất ở đây là hai mức điện thế cao hoặc thấp của mạch khóa hoàn toàn cho một sự tương ứng đơn trị với hai trạng thái của biến hay hàm logic. Nếu sự tương ứng được quy ước là điện thế thấp - trị ''0'' và điện thế cao - trị ''1" ta gọi đó là logic dương. Trong trường hợp ngược lại, với quy ước mức thế thấp trị ''1" và mức thế cao - trị ''0'', ta có logic âm. Để đơn giản, trong chương này, chúng ta chỉ xét với các logic dương. a - Phần tử phủ định logic (phần tử đảo - NO) - Phần tử phủ định có 1 đầu vào biết và 1 đầu ra thực hiện hàm phủ định logic: FNO = x (3-70) tức là FNO = 1 khi x = 0 hoặc ngược lại FNO = 0 khi x = 1. Bảng trạng thái, kí hiệu quy ước và giản đồ thời gian minh họa được cho trên hình 3.31a, b và c tương ứng. Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 226 X FNO 0 1 1 0 Hình 3.31: Bảng trạng thái (a), ký hiệu (b), giản đồ của phần tử NO (c) Để thực hiện hàm FNO, có thể dùng một trong các sơ đồ mạch khóa (tranzito hay IC) đã nêu ở 3.1.2 dựa trên tính chất đảo pha của một tầng Ec đối với tranzito hay đầu vào N của IC thuật toán. Mạch đện thực tế có phức tạp hơn để nâng cao khả năng làm việc tin cậy và khả năng chính xác. Hình 3.32 đưa ra một sơ đồ đảo kiểu TTL (Tranzito-Tranzito-Logic) hoàn thiện trong một vỏ IC số. Mạch ra của sơ đồ gồm 2 tranzito T3 và T4 làm việc ngược pha nhau (ở chế độ khóa) nhờ tín hiệu lấy trên các lối ra phân tải của T2. Mạch vào của sơ đồ dừng tranzito T1 mắc kiểu BC và tín hiệu vào (x) được đưa tới cực emitơ của T1 thể hiện là các xung điện áp cực tính dương (lúc x = 1) có biên độ lớn hơn mức UH hoặc không có xung (lúc x = 0) điều khiển x1 khóa (lúc x = 1) hay mở (lúc x = 0). Nghĩa là khi x = 0 T1 mở, điện thế Uc1 = UB2 ở mức thấp là T2 khóa, điều này làm T3 khóa (vì UE2 ở mức thấp) và T4 mở (vì Uc2 ở mức cao), kết quả là tại đầu ra, điện thế tại điểm A ở mức cao hay FNO = l. Nhờ T4 mở mức thế tại A được nâng lên xấp xỉ nguồn +E (ưu điểm hơn so với việc dùng một điện trở Rc3) nên T4 được gọi là tranzito ''kéo lên", điều này còn làm tăng khả năng chịu tải nhỏ hay dòng lớn cho tầng ra. Khi x = 1, tình hình sẽ ngược lại T1 khóa, T2 mở làm T4 khóa và T3 mở dẫn tới FNO = 0. Nhận xét: - Kết cấu mạch hình 3.32 không cho phép đấu chung các lối ra của hai phần tử đảo kiểu song song nhau (3.32b) vì khi đó nếu FNO1 =1 và FN02 =0 sẽ xảy ra ngắn mạch T4mạch1 với T3mạch2 hoặc ngược lại. Lúc đó cần sử dụng các phần tử NO kiểu để hở colectơ T3 (không có T4) và dùng điện trở Rc3 ở mạch ngoài. - Có thể kết cấu phần tử NO từ 1 cặp MOSFET kênh n và kênh p (một loại thường mở và một loại thường khóa) như hình 3.33. Khi x = 0 (Uvào= 0) T2 mở T1 khóa Ua = UDD hay FNO = 1. Khi x = 1 (Uvào =UDD) T2 khóa T1 mở Ura≈0 hay FNO = 0. FAND = x1x2x3 ... xn (3-71) a) x FNO t t b) c) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 227 Hình 3.32: Bộ đảo TTL có đầu ra hai trạng thái kết cấu dưới dạng một vi mạch số (a). Kiểu mắc chung sai đầu ra cho hai phần tử NO b) Hình 3.33: Sơ đồ NO kiểu CMOS Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 228 Sơ đồ hình 3.33 được chế tạo theo công nghệ CMOS và có ưu điểm căn bản là dòng tĩnh lối vào cũng như lối ra gần bằng 0. b - Phần tử và (AND) là phần tử có nhiều đầu vào biến và một đẩu ra thực hiện hàm nhân logic, tức là hàm FAND . FAND = 1 khi và chỉ khi tất cả các biến xi nhận tri 1 FAND = 0 khi ít nhất 1 trong các biến xi có trị 0 Bảng trạng thái, kí hiệu quy ước và giản đồ thời gian, minh họa của FAND cho hình 3.34 (với n = 2). Mạch điện thực hiện FAND loại đơn giản nhất dựa trên các khóa điôt cho trên hình 3.35, bình thường khi x1 = x2 = 0 nhờ E qua phân áp R1 R2 có UA > 0 các điôt D1 D2 đều mở, điện áp ra ở mức thấp (cỡ bằng sụt áp thuận của điôt) FAND = 0. Tình hình trên không thay đổi khi chỉ x1 = 0 hoặc x2 = 0. X1 X2 FAND 0 0 0 0 1 0 1 0 0 1 1 1 Hình 3.34: Bảng trạng thái (a), ký hiệu (b), giản đồ của phần tử AND (c) Khi x1 = x2 = 1 (ứng với trạng thái các đầu vào có xung vuông biên độ lớn hơn UA) các điôt đều khóa các nhánh đầu vào, lúc đó UA=ER2/(R1+R2) ở thế cao FAND =1 (khi R2 > > R1) Lưu ý khi số lượng đầu vào nhiều hơn số biến, các đầu vào không dùng cần nối với +E để nhánh tương ứng tách khỏi mạch (điôt khóa) tránh được nhiễu với các đầu khác đang làm việc. a) X1 X2 FAND t t t Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 229 Hình 3.35: Sơ đồ nguyên lý mạch AND dựa trên điôt c - Phần tứ hoặc (OR) là phần tử có nhiều đầu vào biến, một đầu ra thực hiện hàm cộng logic: FOR = x1 +x2+x3+...+Xn (3-72) FOR = 1 khi ít nhất một trong các biến xi nhận trị 1. FOR = 0 khi tất cả các biến nhận trị 0: x1 = ... xn = 0 X1 X2 FOR 0 0 0 0 1 1 1 0 1 1 1 1 Hình 3.36: Bảng trạng thái (a) ký hiệu quy ước b) và giản đồ thời gian (c) của phần tử OR Bảng trạng thái kí hiệu quy ước và đồ thị thời gian minh họa của FOR cho trên hình 3.36 (cho với n = l). Có thể dùng khóa điôt thực hiện hàm FOR (3-37). Bình a) b) X1 X2 FOR t t t c) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 230 thường khi x1 = x2 = 0 các điôt đều khóa trên R không có dòng điện Ur = 0. FOR = 0 khi ít nhất một đầu vào có xung dương điôt tương ứng mở tạo dòng trên R do đó UA ở mức cao hay FOR=1. Khi số đầu vào nhiều hơn số biến. đầu vào không dùng được nối đất để chống nhiễu. Hình 3.37: Sơ đồ nguyên lý mạch OR dùng điôt d - Phần tử và phủ định (NAND) là phần tử nhiều đầu vào biến một đầu ra thực hiện hàm logic và - phủ định: FNAND= n321 ...x.x.xx (3-73) FNAND = 0 khi tất cả các đầu vào các biến có trị 1 FNAND = 1 trong các trường hợp còn lại. Hình 3.38 đưa ra bảng trạng thái, kí hiệu quy ước và đồ thị thời gian minh họa trong trường hợp n = 2. X1 X2 FNAND 0 0 1 0 1 1 1 0 1 1 1 0 Hình 3.38: Bảng trạng thái (a) ký hiệu quy ước b) và giản đồ thời gian (c) của phần tử NAND a) X1 X2 FNAND t t t c) b) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 231 - Cũng như các phần tử NO, OR, AND, có thể thực hiện phần tử NAND bằng nhiều cách khác nhau dựa trên các công nghệ chế tạo bán dẫn: loại điện trở tranzito - logic (RTL) loại điôt tranzito - logic (DTL), loại tranzito - tranzito - logic (TTL) hay công nghệ CMOS. Để minh họa, hình 3.39 đưa ra một phần tử NAND dựa trên công nghệ TTL, sử dụng loại tranzito nhiều cực emitơ, có ưu điểm là bảo đảm mức logic, tác động nhanh và khả năng tải lớn. Hình 3.39 : Nguyên lý xây dựng phần tử NAND loại TTL Hình 3.40: Phần từ logic NAND TTL thực tế có đầu vào điều khiển (loại 3 trạng thái ra ổn định) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 232 Với mạch 3.39 khi tất cả các lối vào có điện áp cao (x1 = x2 = x3 = 1) T1 khóa UCM = UB2 ở mức cao làm T2 mở FNAND = 0. Nếu chỉ một trong các lối vào có mức điện áp thấp tiếp giáp emitơ - bazơ tương ứng của T1 mở làm mất dòng IB2 nên T2 khóa: FNAND = 1. Thực tế T2 được thay bằng 1 mạch ra (h.3.40) dạng đẩy kéo tương tự hình 3.32 cho dòng ra lớn tăng khả năng tải và chống nhiễu. Khi T2 khóa T3 cũng khóa (do UE2 = 0) FNAND = 1 nhờ bộ lặp lại cực emitơ T4 trở kháng ra thấp tăng khả năng chịu tải cho toàn mạch. Khi T2 mở T3 mở T4 khóa, D tách nhánh T4 khỏi mạch ra FNAND = 0 (mức ra cỡ + 0,1V). - Để điều khiển tầng ra, có thể dùng một lối vào đặc biệt khi Uđk = 0 (mức thấp) T3 T4 đều bị khóa (trạng thái ổn định thứ 3 của sơ đồ còn gọi là trạng thái trở kháng cao). Khi Uđk ở mức cao điôt D1 khóa, sơ đồ làm việc bình thường như đã phân tích ở trên với hai trạng thái ổn định còn lại. Tín hiệu Uđk được gọi là tín hiệu chọn vỏ (CS) tạo khả năng cho phép (lúc CS = 1) hay không cho phép (lúc CS = 0) mạch NAND làm việc, điều này đặc biệt thuận lợi khi phải điều khiển nhiều NAND làm việc chung với 1 lối ra. e - Phần tử hoặc - phủ định (NOR) gồm nhiều đầu vào biến, một đầu ra thực hiện hàm logic hoặc - phủ định FNOR = n321 x...xxx ++++ (3-74) FNOR = 1 khi mọi biến vào có trị số "0" và FNOR = 0 trong các trường hợp còn lại. Bảng trạng thái, kí hiệu quy ước và giản đồ thời gian minh họa của FNOR (với n = 2) cho trên hình 3.41. X1 X2 FNOR 0 0 1 0 1 0 1 0 0 1 1 0 Hình 3.41: Bảng trạng thái (a) ký hiệu quy ước b) và giản đồ thời gian (c) của phần tử NOR Hình 3.42 cho kết cấu thực hiện FNOR trên công nghệ RTL. Khi ít nhất một trong các cửa vào có xung dương mở, điện áp ra ở mức thấp FNOR = 0, còn khi x1 = x2 = ... = xn = 0, do các tranzito được thiết kế ở chế độ thường khóa. Tất cả các tranzito khóa FNOR = 1 (lưu ý: nếu thiết kế các tranzito thường mở thì mạch hoạt động như 1 phần tử NAND với các xung vào cực tính âm điều khiển khóa các tranzito). X1 X2 FNOR t t t a) b) c) Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 233 - Có thể thực hiện phần tử NOR dựa trên công nghệ MOS hoặc CMOS (từng cặp MOSN và MOSP với mỗi đầu vào) với nhiều ưu điểm nổi bật: thời gian chuyển biến nhanh, không có dòng dò và tiêu thụ công suất cực bé. Hình 3.42 : Phần tử NOR với cực colectơ hở 3.7.3. Các thông số đặc trưng của phần tử IC logic Để đánh giá đặc tính kĩ thuật và khả năng sử dụng của IC logic, người ta thường sử dụng các tham số cơ bản sau: Tính tác động nhanh (phản ứng về thời gian của phần tử với sự biến đổi đột biến của tín hiệu vào) thể hiện qua thời gian trễ trung bình khi xung qua nó: 2 tt trê -+ + =t (3-75) t+ là thồ gian trễ sườn trước khi chuyển mức logic “0” lên “1”. t- là thời gian trễ sườn sau khi chuyển "1" về "0” Nếu ttrễ < 10-8s ta có loại phần tử cực nhanh Nếu ttrễ < 3.10-8s loại nhanh Nếu ttrễ < 3. 10-7s loại trung bình Nếu ttrễ ≥ 0,3 s loại chậm Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 234 - Khả năng sử dụng thể hiện qua số lượng đầu vào m và hệ số phân tải n ở đầu ra (số đầu vào của các phần tử logic khác có thể ghép với đầu ra của nó). Thường n = 4 đến 10, nếu có các mạch khuếch đại đệm ở đầu ra có thể tăng n = 20 đến 50; m = 2 đến 6. - Người ta quy định với những phần tử logic loại TTL, các mức điện áp (với logic dương - mức logic cao và thấp) như sau: Dải đảm bảo mức “1” ở đầu ra +E ≥ Ura ≥ 2,4V Dải đảm bảo mức “0” ở đầu ra 0,4V ≥ Ura.0 ≥ 0V Dải cho phép mức “1” ở đầu vào +E ≥ Uv1 ≥ 2V Dải cho phép mức “0” ở đầu vào 0,8V ≥ Uvo ≥ 0V Như vậy, dự trữ chống nhiễu ở mức “1” là 2 đến 2,4 V Như vậy, dự trữ chống nhiễu ở mức “0” là 0,4 đến 0,8 V - Tính tương hỗ giữa các phần tử logic khi chuyển logic dương thành logic âm: NO -> NO OR -> AND NOR -> NAND Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 235 Mục lục Chương 1: MỞ ĐẦU ................................................................................................... 1 1.1. CÁC ĐẠI LƯỢNG CƠ BẢN ........................................................................... 1 1.1.1 Điện áp và dòng điện .............................................................................. 1 1.1.2. Tính chất điện của một phần tử .............................................................. 2 1.1.3. Nguồn điện áp và nguồn dòng điện......................................................... 5 1.1.4. Biểu diễn mạch điện bằng các kí hiệu và hình vẽ (sơ đồ) ....................... 7 1.2. TIN TỨC VÀ TÍN HIỆU................................................................................... 8 1.2.2. Tin tức ..................................................................................................... 8 1.2.3. Tín hiệu ................................................................................................... 8 1.2.4. Các tính chất của tín hiệu theo cách biểu diễn thời gian τ .....................10 1.3. CÁC HỆ THỐNG ĐIỆN TỬ ĐIỂN HÌNH........................................................12 1.3.2. Hệ thống thông tin thu - phát ..................................................................12 1.3.3. Hệ đo lường điện tử ...............................................................................13 1.3.4. Hệ tự điều chỉnh.....................................................................................14 Chương 2: KỸ THUẬT TƯƠNG TỰ ..........................................................................16 2.1. CHẤT BÁN DẪN ĐIỆN - PHẦN TỬ MỘT MẶT GHÉP P-N ...........................16 2.1.1. Chất bán dẫn nguyên chất và chất bán dẫn tạp chất .............................16 2.1.2. Mặt ghép p-n và tính chỉnh lưu của đốt bán dẫn ....................................21 2.1.3. Vài ứng dụng điển hình của điôt bán dẫn...............................................27 2.2. PHẦN TỬ HAI MẶT GHÉP P-N ....................................................................37 2.2.1. Cấu tạo, nguyên lí làm việc, đặc tuyến và tham số của tranzito bipolar .37 2.2.2. Các dạng mắc mạch cơ bản của tranzito...............................................42 2.2.3. Phân cực và ổn định nhiệt điểm công tác của tranzito ...........................47 2.2.4. Tranzito trường (FET) ............................................................................62 2.3. KHUẾCH ĐẠI ................................................................................................73 2.3.1. Những vấn đề chung..............................................................................73 2.3.2. Khuếch đại dùng tranzito lưỡng cực ......................................................83 2.4 KHUẾCH ĐẠI DÙNG VI MẠCH THUẬT TOÁN ...........................................134 2.4.1 Khái niệm chung...................................................................................134 2.4.2. Bộ khuếch đại đảo................................................................................138 2.4.3. Bộ khuếch đại không đảo.....................................................................139 2.4.4. Mạch cộng............................................................................................139 2.4.5. Mạch trừ ...............................................................................................141 2.4.6. Bộ tích phân .........................................................................................143 2.4.7. Bộ vi phân ............................................................................................144 2.4.8. Các bộ biến đổi hàm số........................................................................145 2.4.9. Các mạch lọc .......................................................................................146 2.5. TẠO DAO ĐỘNG ĐIỀU HÒA ......................................................................149 2.5.1. Nguyên lý chung tạo dao động điều hoà ..............................................149 2.5.2. Máy phát dao động hình sin dùng hệ tự dao động gần với hệ bảo toàn tuyến tính .............................................................................................151 2.5.3. Tạo tín hiệu hình sin bằng phương pháp biến dổi từ một dạng tín hiệu hoàn toàn khác.....................................................................................157 Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 236 2.6. NGUỒN MỘT CHIỀU..................................................................................161 2.6.1. Khái niệm chung...................................................................................161 2.6.2. Lọc các thành phần xoay chiều của dòng điện ra tải............................162 2.6.3. Đặc tuyến ngoài của bộ chỉnh lưu........................................................165 2.6.4. Ổn định điện áp và dòng điện ..............................................................166 2.6.5. Bộ ổn áp tuyến tính IC..........................................................................181 2.7. PHẦN TỬ NHIỀU MẶT GHÉP P-N .............................................................186 2.7.1. Nguyên lí làm việc, đặc tuyến và tham số của tiristo............................186 2.7.2. Các mạch khống chế điển hình dùng tiristo .........................................188 2.7.3. Vài dụng cụ chỉnh lưu có cấu trúc 4 lớp ...............................................193 Chương 3: KĨ THUẬT XUNG - SỐ...........................................................................197 3.1. KHÁI NIỆM CHUNG....................................................................................197 3.1.1. Tín hiệu xung và tham số .....................................................................197 3.1.2. Chế độ khóa của tranzito .....................................................................199 3.1.3. Chế độ khóa của khuếch đại thuật toán ...............................................201 3.2. MẠCH KHÔNG ĐỒNG BỘ HAI TRẠNG THÁI ỔN ĐỊNH ............................203 3.2.1. Tri gơ đối xứng (RS-trigơ) dùng tranzito ..............................................203 3.2.2. Tri gơ Smit dang Tranzito.....................................................................204 3.2.3. Trigơ Smit dùng IC tuyến tính ..............................................................206 3.3. MẠCH KHÔNG ĐỒNG BỘ MỘT TRẠNG THÁI ỔN ĐỊNH ..........................208 3.3.1. Đa hài đợi dùng tranzito .......................................................................208 3.3.2. Mạch đa hài đợi dùng IC thuật toán .....................................................209 3.4. MẠCH KHÔNG ĐỒNG BỘ HAI TRẠNG THÁI KHÔNG ỔN ĐỊNH (ĐA HÀI TỰ DAO ĐỘNG) ..........................................................................................................211 3.4.1. Đa hài dùng tranzito .............................................................................211 3.4.2. Mạch đa hài dàng IC tuyến tính............................................................213 3.5. BỘ DAO ĐỘNG BLOCKING .......................................................................214 3.6. MẠCH TẠO XUNG TAM GIÁC (XUNG RĂNG CƯA)..................................216 3.6.1. Các vấn đề chung ................................................................................216 3.6.2. Mạch tạo xung tam giác dùng tranzito..................................................219 3.6.3. Mạch tạo xung tam giác dùng vi mạch thuật toán ................................220 3.7. CƠ SỞ ĐẠI SỐ LOGIC VÀ CÁC PHẦN TỬ LOGIC CƠ BẢN ....................224 3.7.1. Cơ số của đại số logic ..........................................................................224 3.7.2. Các phần tứ togic cơ bản.....................................................................225 3.7.3. Các thông số đặc trưng của phần tử IC logic.......................................233 Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark. 237 Tài liệu tham khảo [1]. Nguyễn Bính (2000), Điện tử công suất, Nhà xuất bản Khoa học và Kỹ thuật, Hà nội. [2]. Đỗ Xuân Thụ (chủ biên) (2005), Kỹ thuật điện tử, Nhà xuất bản Giáo dục, Hà nội. [3]. Work Bench 5.12 [4]. www.nano.physik.uni-muenchen.de Please purchase PDF Split-Merge on www.verypdf.com to remove this watermark.